Quasi pronte le specifiche PCI Express 4.0, mentre quelle 5.0 si affacciano all'orizzonte

Quasi pronte le specifiche PCI Express 4.0, mentre quelle 5.0 si affacciano all'orizzonte

PCI-SIG è pronta a finalizzare le specifiche PCI Express 4.0, che guideranno le caratteristiche tecniche dei componenti di prossima generazione con un raddoppio della bandwidth massima

di pubblicata il , alle 11:01 nel canale Scienza e tecnologia
 

PCI-SIG, l'organismo che ratifica le specifiche legate al funzionamento e alla compatibilità delle periferiche PCI Express, ha annunciato le nuove specifiche PCI Express 4.0 alle aziende che sono affiliate. Al pari di quanto avvenuto in passato il nuovo sistema di interconnessione porterà ad un raddoppio della bandwidth a parità di numero di linee PCI Express utilizzate.

La disponibilità di specifiche aggiornate, con un incremento della bandwidth massima, si rivela essere particolarmente interessante non solo pensando alle esigenze delle schede video di prossima generazione ma anche per l'utilizzo in ambiti professionali come quello del mondo server. In generale le connessioni PCI Express hanno trovato utilizzo diffuso in ambito consumer quando sfruttate per le periferiche di storage più veloci, così da andare oltre alle limitazioni dell'interfaccia SATA e servirsi al meglio dell'elevata bandwidth offerta dagli SSD più recenti.

pci-sig-spec_4-5.jpg (74157 bytes)

Le nuove specifiche prevedono anche la possibilità di gestire interconnessioni con un maggior numero di linee e velocità differenti, così da meglio andare incontro alle necessità di applicazioni nelle quali si richieda un consumo particolarmente contenuto. PCI-SIG ha confermato di aver già eseguito vari test con alcuni membri del consorzio per ottenere la velocità di trasferimento di 16 GT/s per interconnessione così come previsto dalle specifiche. Le specifiche PCIe 4.0 sono alla revision 0.9: i membri del PCI-SIG hanno tempo sino al prossimo 9 agosto per sottoporre osservazioni e note a riguardo.

Per il 2019 si attende il debutto delle specifiche PCI Express 5.0, che permetteranno di ottenere un ulteriore raddoppio della bandwidth massima complessiva rispetto a quello delle specifiche PCI Express 4.0. Con una connessione 16x full duplex le specifiche PCIe 5.0 permettono di ottenere sulla carta una bandwidth di trasferimento massima teorica di ben 128 GB/s, un dato doppio rispetto ai 64 GB/s delle specifiche PCIe 4.0 e quadruplo prendendo quale riferimento l'attuale implementazione PCIe 3.0.

9 Commenti
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Rubberick09 Giugno 2017, 11:36 #1
Non mi trovo con quella tabella per quanto riguarda il x 1 e x 16..

4 x 16 fa 64 non 128 come nell'ultima riga e allo stesso modo su..
aqua8409 Giugno 2017, 11:50 #2
Originariamente inviato da: Rubberick
Non mi trovo con quella tabella per quanto riguarda il x 1 e x 16..

4 x 16 fa 64 non 128 come nell'ultima riga e allo stesso modo su..

ma il pci 4.0 è la penultima riga
Benjamin Reilly09 Giugno 2017, 13:53 #3
la trasmissione del bus sarà ottica o in rame?
Emin00109 Giugno 2017, 16:09 #4
Originariamente inviato da: aqua84
ma il pci 4.0 è la penultima riga


Non c'entra nulla, l'ultima colonna ha valori doppi rispetto al dovuto( moltiplicare per 16 il valore di una singola linea).
tuttodigitale09 Giugno 2017, 16:36 #5
Originariamente inviato da: Emin001
Non c'entra nulla, l'ultima colonna ha valori doppi rispetto al dovuto( moltiplicare per 16 il valore di una singola linea).

giustissimo
konamikcej09 Giugno 2017, 16:40 #6
Originariamente inviato da: Emin001
Non c'entra nulla, l'ultima colonna ha valori doppi rispetto al dovuto( moltiplicare per 16 il valore di una singola linea).


La penultima colonna indica la banda per linea per via (lettura o scrittura).

250MB/s * 16 lanes * 2 ways (Lettura e Scrittura) = 8GB\s (PCIe 1.x)
AleLinuxBSD09 Giugno 2017, 18:31 #7
Sarebbe pure ora che esca Pci Express 4.0.
aqua8411 Giugno 2017, 13:48 #8
Originariamente inviato da: konamikcej
La penultima colonna indica la banda per linea per via (lettura o scrittura).

250MB/s * 16 lanes * 2 ways (Lettura e Scrittura) = 8GB\s (PCIe 1.x)


ma infatti secondo me Emin001 nn ha ben capito la tabella, e meno ancora "tuttodigitale" che gli da ragione
Emin00111 Giugno 2017, 16:15 #9
Tanto per chiarire:

1) Ti ho solo fatto notare che il dubbio di Rubberick non era legato al PCIe 4.0. Se io non ho capito nulla tu non hai nemmeno lontanamente afferrato quanto scritto da Rubberick.

2) Quella tabella gira da anni con la dicitura per esteso "Bandwidth per lane direction"(es. http://www.anandtech.com/show/2412/2) e non abbreviato BW/LANE/WAY quindi stai tranquillo che ho ben capito(vale anche per konamikcej) ma non sono affatto d'accordo. I valori dell'ultima colonna vanno dimezzati per coerenza con i valori scritti in precedenza o quanto meno va scritto che si tratta di un valore globale e non sono il solo a pensarla in questo modo visto che non è difficile trovare tabelle e/o scritti con i valori non aggregati:
http://www.ibmsystemsmag.com/getatt...a-ddceb52d43f5/ https://image.slidesharecdn.com/pci...g?cb=1408809368 http://hexus.net/tech/news/mainboar...power-delivery/ http://www.hardwaresecrets.com/ever...-pci-express/3/.

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